Fast, Efficient and Predictable Memory Accesses Optimization Algorithms for Memory Architecture Aware Compilation
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Sprache:Englisch
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inkl. gesetzl. MwSt.Beschreibung
Produktdetails
Format
Kopierschutz
Nein
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Nein
Text-to-Speech
Nein
Erscheinungsdatum
08.09.2006
Verlag
Springer NetherlandsSeitenzahl
258 (Printausgabe)
Dateigröße
2553 KB
Sprache
Englisch
EAN
9781402048227
Fast, Efficient and Predictable Memory Accesses presents techniques for designing fast, energy-efficient and timing predictable memory systems. By using a careful combination of compiler optimizations and architectural improvements, we can achieve more than what would be feasible at one of the levels in isolation. The described optimization algorithms achieve the goals of high performance and low energy consumption. In addition to these benefits, the use of scratchpad memories significantly improves the timing predictability of the entire system, leading to tighter worst case execution time bounds (WCET). The WCET is a relevant design parameter for all timing critical systems. In addition, the book covers algorithms to exploit the power down modes of main memories in SDRAM technology, as well as the execute-in-place feature of Flash memories. The final chapter considers the impact of the register file, which is also part of the memory hierarchy.
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