SAT-Based Scalable Formal Verification Solutions
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Sprache:Englisch
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Beschreibung
Produktdetails
Einband
Gebundene Ausgabe
Erscheinungsdatum
22.05.2007
Abbildungen
XXX, 330 p. 118 illus.
Verlag
Springer UsSeitenzahl
330
Maße (L/B/H)
24,1/16/2,4 cm
Gewicht
705 g
Sprache
Englisch
ISBN
978-0-387-69166-4
Functional verification has become an important aspect of the chip design process. Significant resources, both in industry and academia, are devoted to the design complexity and verification endeavors.
SAT-Based Scalable Formal Verification Solutions
discusses in detail several of the latest and interesting scalable SAT-based techniques including: Hybrid SAT Solver, Customized Bounded/Unbounded Model Checking, Distributed Model Checking, Proofs and Proof-based Abstraction Methods, Verification of Embedded Memory System & Multi-clock Systems, and Synthesis for Verification Paradigm. These techniques have been designed and implemented in a verification platform Verisol (formally called DiVer) and have been used successfully in industry. This book provides algorithmic details and engineering insights into devising scalable approaches for an effective realization. It also includes the authors’ practical experiences and recommendations in verifying the large industry designs using VeriSol.
The book is primarily written for researchers, scientists, and verification engineers who would like to gain an in-depth understanding of scalable SAT-based verification techniques. The book will also be of interest for CAD tool developers who would like to incorporate various SAT-based advanced techniques in their products.
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