Scalable Hardware Verification with Symbolic Simulation
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- Taschenbuch
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Sprache:Englisch
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inkl. gesetzl. MwSt.,
Beschreibung
Produktdetails
Einband
Gebundene Ausgabe
Erscheinungsdatum
21.12.2005
Abbildungen
XX, 180 p. 40 illus.
Verlag
Springer UsSeitenzahl
180
Maße (L/B/H)
24,2/16,5/1,7 cm
Gewicht
468 g
Auflage
2006 edition
Sprache
Englisch
ISBN
978-0-387-24411-2
In structuring this book, the author’s hope was to provide interesting reading for a broad range of design automation readers. The first two chapters provide an overview of digital systems design and, in particular, verification. Chapter 3 reviews mainstream symbolic techniques in formal verification, dedicating most of its focus to symbolic simulation. The fourth chapter covers the necessary principles of parametric forms and disjoint-support decompositions. Chapters 5 and 6 focus on recent symbolic simulation techniques, and the final chapter addresses key topics needing further research.
Scalable Hardware Verification with Symbolic Simulation is for verification engineers and researchers in the design automation field.
Highlights:
A discussion of the leading hardware verification techniques, including simulation and formal verification solutions
Important concepts related to the underlying models and algorithms employed in the field
The latest innovations in the area of symbolic simulation, exploiting techniques such as parametric forms and decomposition properties of Booleanfunctions
Providing insights into possible new developments in the hardware verification
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